Questão 1410431

1410431 Ano: 2012
Disciplina: Engenharia Eletrônica
Banca: FUNRIO
Orgão: CEITEC

Provas:

Sobre retime durante a fase de síntese, pode-se afirmar o seguinte:

É o processo de escolha das células lógicas apropriadas para se atingir slack positivo.

É a etapa de recalcular o timing após uma rodada de backannotation.

Consiste em fazer static timing analysis para o clock mais lento em um projeto de múltiplos clocks.

Reposiciona registradores para melhorar os resultados de desempenho, sem afetar a lógica ou a latência.

Representa a escolha do processo mais lento após duas rodadas de slack.

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