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Foram encontradas 50 questões.

3232925 Ano: 2015
Disciplina: TI - Organização e Arquitetura dos Computadores
Banca: UFRN
Orgão: UFERSA
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Uma memória cache associativa por conjunto – contendo 2 conjuntos e 256 linhas, cada linha possuindo 16 bytes – tem capacidade de armazenamento de

 

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3232924 Ano: 2015
Disciplina: TI - Organização e Arquitetura dos Computadores
Banca: UFRN
Orgão: UFERSA
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Uma memória cache segue uma política de substituição de linhas em que um dado, ao ser comandado pelo processador para escrita na hierarquia de memórias, ocorrendo um acerto (hit), é gravado tanto na cache como na memória principal. Essa política é a

 

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3232923 Ano: 2015
Disciplina: TI - Organização e Arquitetura dos Computadores
Banca: UFRN
Orgão: UFERSA
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Numa hierarquia de memórias, usa-se costumeiramente uma memória cache que tem uma ‘velocidade’ maior que a memória principal. O custo de armazenamento por byte, porém, é mais alto. Em comparação com uma memória principal, a capacidade de armazenamento de uma memória cache é

 

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3232922 Ano: 2015
Disciplina: TI - Organização e Arquitetura dos Computadores
Banca: UFRN
Orgão: UFERSA
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O arranjo da via de dados que explora o paralelismo de instruções em um fluxo sequencial, que é completamente invisível ao programador, mas melhora o desempenho final da execução de um código é o

 

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3232921 Ano: 2015
Disciplina: TI - Organização e Arquitetura dos Computadores
Banca: UFRN
Orgão: UFERSA
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Numa via de dados, o bloco lógico que controla a geração de sinais os quais identificam as operações a serem realizadas na Unidade Lógica e Aritmética e os registradores envolvidos nessas operações, denomina-se

 

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3232920 Ano: 2015
Disciplina: TI - Organização e Arquitetura dos Computadores
Banca: UFRN
Orgão: UFERSA
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Observe o mapa de Karnought a seguir.

Enunciado 3571296-1 00 01 11 10
00
01 1 1 1 1
11
10 1 1 1 1

Uma expressão que gera esse mapa é

 

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3232919 Ano: 2015
Disciplina: TI - Organização e Arquitetura dos Computadores
Banca: UFRN
Orgão: UFERSA
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Observe o circuito de uma unidade lógica e aritmética elementar a seguir.

Enunciado 3571295-1

Quando o OpCode desse circuito estiver nos níveis lógicos 102, a operação de saída dessa ULA será

 

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3232918 Ano: 2015
Disciplina: TI - Organização e Arquitetura dos Computadores
Banca: UFRN
Orgão: UFERSA
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Analise o circuito combinacional a seguir.

Enunciado 3571294-1

Esse circuito contém um codificador e um decodificador de hamming que permite a detecção e correção de erros de transmissão de dados. Considerando os valores lógicos d0=0, d1=1, d2=0 e d3=1, e que a transmissão sofreu uma mudança de valor lógico na linha d1-D1, passando para 0 o valor lógico de saída da transmissão nessa linha, os valores dos sinalizadores s0, s1, s2 e s3 são, respectivamente

 

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3232917 Ano: 2015
Disciplina: TI - Desenvolvimento de Sistemas
Banca: UFRN
Orgão: UFERSA
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Observe o circuito abaixo.

Enunciado 3571293-1

Esse circuito implementa a seguinte expressão lógica

 

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3232916 Ano: 2015
Disciplina: TI - Organização e Arquitetura dos Computadores
Banca: UFRN
Orgão: UFERSA
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Flip-flops e latches são comuns em projetos de circuitos digitais sequenciais. Os Flip-flops mais comuns são do tipo D, T e JK. O projeto de circuitos pode seguir abordagens distintas. Uma delas usa as entradas CLEAR e PRESET dos flip-flops. O efeito dessas entradas assíncronas nos flip-flops é:

 

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