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Sabendo que as necessidades brutas de um conector para a semana 3 é de 150 unidades e que o saldo do estoque disponível projetado no final da semana 2 é de 30 unidades, o tamanho do lote para chegar à semana 3, considerando a regra lote por lote, é de
 

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1405190 Ano: 2012
Disciplina: Direito Tributário
Banca: FUNRIO
Orgão: CEITEC
A Constituição Federal de 1988, e alterações, veda a vinculação da receita de impostos a órgão, fundo ou despesa, sendo ressalvada, dentre outras, a
 

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1405185 Ano: 2012
Disciplina: Engenharia Eletrônica
Banca: FUNRIO
Orgão: CEITEC
Uma técnica metrológica de grande importância em microfabricação é a microscopia de força atômica. Com relação ao uso dessa ferramenta em microeletrônica NÃO se pode afirmar o seguinte:
 

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1405175 Ano: 2012
Disciplina: Engenharia Eletrônica
Banca: FUNRIO
Orgão: CEITEC
Assinale a alternativa que contém somente processos que retirem o fotorresiste.
 

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1405163 Ano: 2012
Disciplina: TI - Banco de Dados
Banca: FUNRIO
Orgão: CEITEC
De acordo com o padrão SQL ANSi , dado o conjunto abaixo, quais são Valores literais?
1. +30
2. -5.6
3. 'True'
4. '12345'
 

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1405162 Ano: 2012
Disciplina: Direito Penal
Banca: FUNRIO
Orgão: CEITEC
É considerado, nos termos do Código Penal, crime praticado por funcionário contra a Administração Pública:
 

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1405088 Ano: 2012
Disciplina: Engenharia Mecânica
Banca: FUNRIO
Orgão: CEITEC
Atualmente, são adotados 6 (seis) diferentes tipos de curvas de falha utilizados para caracterizar a vida dos equipamentos. O padrão de curva que apresenta probabilidade de falha totalmente aleatória com a idade do equipamento é
 

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1405083 Ano: 2012
Disciplina: Engenharia Eletrônica
Banca: FUNRIO
Orgão: CEITEC
Em um substrato de silício fortemente dopado com Boro, é crescida uma camada epitaxial fracamente dopada com Boro, dentro da qual pode ser criada uma região denominada poço n. Qual é a principal finalidade do poço n em uma tecnologia CMOS em que se pretende alta densidade de transistores?
 

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1405075 Ano: 2012
Disciplina: Engenharia Eletrônica
Banca: FUNRIO
Orgão: CEITEC
Qual o resultado da simulação do código abaixo, quando compilado com um simulador que suporta SystemVerilog 2009?
module test;
logic [32:0] o = 'bx;
initial $display("o = %b", o);
endmodule
 

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1405062 Ano: 2012
Disciplina: Administração Geral
Banca: FUNRIO
Orgão: CEITEC
Qual das afirmações abaixo é incorreta?
 

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